19.5 习题：在纸上踩坑

走到这里，你已经看完了全章的理论。你是真的懂了，还是只是「觉得懂了」？

下面这些问题会把你推向极限。

有些题目是直接的算术，有些需要你动用 MATLAB 或 Python，还有些——尤其是关于极限环和无振荡条件的那几道——会强迫你回头去审视那些被你一笔带过的假设。

💡 起手提示（给第 19.1 题当脚手架）：纯计数器型 DPWM 的有效位数 $n_{DPWM}=\lfloor {\log }_2(f_{clk}/f_s)\rfloor$。把 $f_{clk}=120\text{ MHz}$ 代进去——当 $f_s=100\text{ kHz}$ 时 $f_{clk}/f_s=1200$，${\log }_{2}1200\approx 10.2$，所以你能拿到 10 位；可一旦 $f_s$ 拉到 $1\text{ MHz}$，比值缩成 120，${\log }_{2}120\approx 6.9$，只剩 6 位。这道题就是让你亲手摸到「开关频率上去、分辨率下来」这条残酷的线性绳。后面 19.2 题换成 150 ps 的 HR-PWM，同样的三个 $f_s$，你会看到位数几乎不再被开关频率绑架——这就是为什么现代数字电源控制器里 HR-PWM 是刚需，不是奢侈品。

建议：不要急着看答案。先把 19.7 的仿真跑通，如果那个闭环波形能稳定住，再去挑战 19.9 的全系统设计。

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19.1 计数器的墙

想象你手里有一块现成的微控制器，时钟频率 $f_{clk}=120\text{ MHz}$，内部是用最简单的计数器实现的 DPWM（没有延迟线那些花活儿）。你用它来控制开关电源，工作在三种不同的开关频率下： (i) $f_s=100\text{ kHz}$ (ii) $f_s=250\text{ kHz}$ (iii) $f_s=1\text{ MHz}$

对于这三种情况，请分别计算出 DPWM 的有效分辨率位数 $n_{DPWM}$。你会看到那个残酷的线性关系：一旦 $f_s$ 跑上去，位数 $n_{DPWM}$ 就会像自由落体一样掉下来。

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19.2 购买分辨率

这次不省钱，换了一个高端微控制器。它的 DPWM 模块号称拥有 150 ps 的时间分辨率——这是靠混合延迟线或抖动技术硬堆出来的。

同样的三个测试频率： (i) $f_s=100\text{ kHz}$ (ii) $f_s=250\text{ kHz}$ (iii) $f_s=1\text{ MHz}$

请计算这时的等效 $n_{DPWM}$。对比上一题的结果，你会发现为什么现代数字电源控制器不能仅靠计数器，必须引入高分辨率（HR）PWM 模块。

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19.3 电压定位的极限

一个带有 $n_{DPWM}$ 位分辨率的数字控制器正在控制一个变换器。设直流变换比为 $M(D)=V/V_g$。

我们需要推导一个表达式： 当占空比 $D$ 变化一个 LSB（即 $q_{DPWM}$）时，输出电压 $V$ 会跳变多少？请用百分比 $p_v=\mathrm{\Delta }V/V$ 来表示这个相对步进，并把结果写成 $M(D)$ 和 $n_{DPWM}$ 的函数。

在这个通用公式的基础上，请针对三种基本拓扑推导具体的 $p_v$ 表达式： (i) Buck: $M(D)=D$ (ii) Boost: $M(D)=1/(1-D)$ (iii) Buck-Boost: $M(D)=D/(1-D)$

思考：在极高压差（Deep Step-down 或 High Step-up）的情况下，也就是 $D$ 很小或 $D$ 接近 1 时，输出电压的定位精度会发生什么变化？这是不是解释了为什么高压 Buck 转换器极其难调？

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19.4 不浪费的 A/D 量程

你在设计一个数字电源，输出电压要稳在 $V=V_{ref}/H_0$。 手里的 A/D 转换器参数是：$n_{A/D}=10$ 位，满量程电压 $V_{FS}=2\text{ V}$。

在负载瞬态发生时，输出电压可能会在额定值 $V=12\text{ V}$ 上下浮动 $\pm 10\mathrm{\%}$。 你的任务是设计 $V_{ref}$ 和采样增益 $H_0$，使得：

1. 不饱和：在 $\pm 10\mathrm{\%}$ 的波动范围内，A/D 永远不打到满量程或地板（留有余量）。
2. 精度最大化：让系统的调节精度 $\mathrm{\Delta }V$（对应 A/D 的 1 LSB）尽可能小。

请给出 $V_{ref}$, $H_0$, $\mathrm{\Delta }V$ 的具体数值。

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19.5 窗口 A/D 的算术题

这次用的是窗口 A/D 转换器（我们在上一节提到过，这东西像是个带孔的遮光板，只看参考电压 $V_{ref}$ 附近的那一小段）。

已知：

• 转换器围绕 $V_{ref}$ 分布，每个量化台阶宽 $q_{A/D}=5\text{ mV}$。
• 目标稳压值 $V=12\text{ V}$。
• 参考电压 $V_{ref}=2\text{ V}$。

要求与上一题类似：允许 $\pm 10\mathrm{\%}$ 的输出波动，且 A/D 不能饱和。 请计算：

1. 所需的直流采样增益 $H_0$。
2. 这时系统可分辨的最小电压步进 $\mathrm{\Delta }V$ 是多少？
3. 为了覆盖整个 $\pm 10\mathrm{\%}$ 的范围，这个窗口 A/D 至少需要多少个_bins_（比较器级数）？

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19.6 模拟到数字的映射（MATLAB 实验）

这是本章最核心的技能演练。我们有一个模拟比例-微分（PD）补偿器：

$$G_c(s)=G_{c0}\frac{1+s/{\omega }_z}{1+s/{\omega }_p}$$

其中 $G_{c0}=1$，零点频率 $f_z=10\text{ kHz}$，极点频率 $f_p=100\text{ kHz}$。 根据经典控制理论，最大相位超前出现在几何中心频率 $f_x=\sqrt{f_z{f}_p}\approx 31.6\text{ kHz}$。

请动用 MATLAB 或任何你喜欢的工具（Python Control Library 也行）：

(a) 绘制模拟原型的 Bode 图 构建 $G_c(s)$ 的 Bode 图，并计算在以下三个频率点的幅值（dB）和相位（度）： (i) $f=f_z$ (ii) $f=f_x$ (iii) $f=f_p$

(b) 离散化与频率预畸变 使用双线性变换法，将 $G_c(s)$ 映射到离散域 $G_{cd}^{\ast }(z)$。 注意：必须引入频率预畸变，预畸变点设在 $f_{prewarp}=f_x$（我们最关心穿越频率处的特性）。

请在三种采样频率下进行映射：$f_s=500\text{ kHz}$, $250\text{ kHz}$, $150\text{ kHz}$。

对于每一种 $f_s$，计算 $G_{cd}^{\ast }$ 在 (i), (ii), (iii) 三个频率处的响应，并与 中的结果对比。 叠加绘制：把模拟 $G_c(s)$ 和三个不同 $f_s$ 下的 $G_{cd}^{\ast }(z)$ 的 Bode图画在一起。观察 $f_s$ 降低时，离散引入的相位滞后是如何侵蚀相位裕量的。

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19.7 Boost 变换器的数字积分控制（全链路设计）

考虑一个闭环 Boost 稳压器（类似第 9 章那道题的拓扑，但现在控制器由你来写代码）。 元件视为理想。电压传感器的传递函数为：

$$H(s)=\frac{H_0}{1+s/{\omega }_p}$$

其中 $H_0=1/120$，极点 $f_p=10\text{ kHz}$。

• 电压参考 $V_{ref}=1\text{ V}$。
• A/D 满量程 $V_{FS}=2\text{ V}$。
• DPWM 采用后沿调制，$V_M=1\text{ V}$。
• 补偿器采用离散积分器 $G_{cd}(z)$。
• 假设：A/D 和 DPWM 分辨率极高（无穷位），暂且忽略量化误差。
• 采样：每个开关周期 $T_s$ 采样一次 $v_s$。
• 延迟：计算延迟为 0，调制器延迟为 $t_d=t_{mod}=D{T}_s$。

(a) 稳态工作点 计算稳态输出电压 $V$、占空比 $D$ 以及环路延迟 $t_d$。

(b) 模拟基准设计 假设我们先用模拟控制器，且忽略延迟。设计一个模拟积分补偿器 $G_c(s)=K_c/s$。 目标：穿越频率 $f_c=125\text{ Hz}$。 请确定 $K_c$。 绘制此时的开环传递函数 $T(s)$ 的 Bode 图，标注所有转折频率，并计算相位裕量。

(c) 数字域复现 按照 19.3 节的流程，设计一个离散时间积分补偿器 $G_{cd}(z)$。 目标：保持与 相同的 $f_c$ 和相位裕量。 请叠加绘制 $T(s)$ 和 $T_d(z)$ 的 Bode 图，数值验证你的穿越频率和相位裕量是否达标。

(d) 现实降临（量化误差） 现在把 A/D 和 DPWM 拉回现实。 要求：直流输出电压必须被控制在 $\pm 0.25\text{ V}$ 的误差范围内。 请找出满足无极限环振荡条件（Eq. 19.79）所需的：

• 最小 A/D 分辨率 $n_{A/D}$
• 最小 DPWM 分辨率 $n_{DPWM}$

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19.8 正激变换器的数字控制

考虑一个数字控制的正激变换器（结构类似第 9 章那道正激变换器的题目）。

• 输入电压 $V_g=380\text{ V}$。
• 变压器匝比 $n_1/n_3=4.5$。
• DPWM 限制占空比 $0\le d(t)\le 0.5$，且在范围内 $d[n]=v_c[n]/V_M$，其中 $V_M=1\text{ V}$。
• DPWM 特性：双沿调制，分辨率 $n_{DPWM}=12$ 位。
• A/D 特性：分辨率 $n_{A/D}=9$ 位，每 $T_s$ 采样一次。
• 环路延迟：$t_d=T_s/2$。
• A/D 和 DPWM 增益视为 1。
• 补偿器已给定：$G_{cd}(z)=0.1152\frac{z-0.91}{z-1}$。

(a) 稳态计算 计算静态占空比 $D$ 和输出电压 $V$。

(b) 模型推导 推导控制-to-输出传递函数 $G_{vd}(s)$ 和未补偿环路增益 $T_u(s)$。 注意：必须包含传感器 $H(s)$ 和环路延迟 $t_d$ 的影响。

(c) 稳定性分析 绘制环路增益 $T_d$ 的 Bode 图。 求出穿越频率 $f_c$ 和相位裕量 ${\varphi }_m$。

(d) 极限环检查 验证该系统是否满足无极限环振荡条件（Eq. 19.79）。

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19.9 Buck-Boost 变换器的综合设计（大作业）

这是本章的 Boss 级挑战。你要从头设计一个数字控制的 Buck-Boost 稳压器，工作在 CCM 模式。

• 元件参数：$L=22\mu \text{H}$，$C=47\mu \text{F}$（ESR $=20\text{m}\mathrm{\Omega }$），负载 $R=7.5\mathrm{\Omega }$，开关频率 $f_s=250\text{ kHz}$。
• 输入 $V_g=48\text{ V}$，目标输出 $-15\text{ V}$（负压！）。
• 设计指标：高穿越频率（但不超过 $0.1f_s$），低频高增益，相位裕量 $\ge {45}^{\circ }$。
• A/D 限制：最高 12 位（$n_{A/D}\le 12$）。
• DPWM 限制：最高 10 位（$n_{DPWM}\le 10$），后沿调制。
• 延迟：$t_d=t_{mod}=D{T}_s$。
• 传感器 $H(s)$ 带反相增益和一个抗混叠滤波器极点 $f_p=100\text{ kHz}$。

(a) 量化系统配置

1. 确定所需的 $H_0$。
2. 在满足 Eq. (19.76) 无振荡条件的前提下，选择能提供最佳直流精度的 $n_{A/D}$ 和 $n_{DPWM}$。

(b) 补偿器设计 设计离散补偿器 $G_{cd}(z)$。 绘制未补偿环路增益 $T_{ud}$ 的 Bode 图（含延迟），以及你的补偿器 $G_{cd}(z)$ 的响应。 标注关键特征。验证 Eq. (19.79) 是否满足。

(c) 系统验证 绘制最终环路增益 $T_d(z)$ 的幅频/相频特性，以及灵敏度函数 $T_d/(1+T_d)$ 和 $1/(1+T_d)$。 计算最终的 $f_c$ 和 ${\varphi }_m$。

(d) 设计反思 讨论你的设计。什么因素限制了你进一步提高穿越频率？是采样率？还是延迟？

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19.10 平均电流模式的数字化

这是一个关于电流环的题目。先看经典的模拟平均电流模式控制 Boost 变换器。 模拟补偿器为：

$$G_{ci}(s)=G_{cm}\frac{1+{\omega }_z/s}{1+s/{\omega }_p}$$

参数：$G_{cm}=0.63,f_z=4\text{ kHz},f_p=25\text{ kHz}$。 采样电阻 $R_f=0.25\mathrm{\Omega }$。

现在把它搬到数字域。它的数字孪生版本里，电流采样增加了一个模拟单极点抗混叠滤波器：

$$\frac{v_s}{i_L}=R_f\frac{1}{1+s/{\omega }_a}$$

参数：$f_a=200\text{ kHz}$。 其余功率级参数相同。 假设 A/D 和 DPWM 都是理想高分辨率（增益为 1）。

时序上有几个关键细节要盯紧：

• 采样点：电感电流采样点。
• DPWM 类型：注意这是双沿（三角波）调制。
• 延迟：$t_d=T_s/2$。

(a) 模拟稳态 对于模拟控制器，计算稳态工作点：$I_L,V,D,V_c,V_{ref}$。

(b) 模拟环路分析 基于点，绘制电流环路增益 $T_i(s)$ 的 Bode 图，求出穿越频率 $f_{ci}$ 和相位裕量 ${\varphi }_i$。

(c) 数字稳态 对于数字控制器，计算稳态工作点：$I_L,V,D,V_c[n],V_{ref}$。

(d) 延迟的影响 在 中找到的 $f_{ci}$ 频率处，计算由调制器延迟 $t_d$ 引入的额外相位滞后 $\mathrm{\Delta }{\varphi }_d$。

(e) 电流环的数字化重构 设计一个离散补偿器 $G_{cid}^{\ast }(z)$。 目标：穿越频率和相位裕量与模拟版（部分）完全一致。 使用双线性变换，并在 $f_{ci}$ 处进行预畸变。 给出 $G_{cid}^{\ast }(z)$ 的极点/零点表达式，展示推导过程。 最后，叠加绘制模拟环路增益 $T_i(s)$ 和数字环路增益 $T_{id}(z)$ 的 Bode 图，验证你的设计是否复刻了模拟的性能。

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本章回响：模拟与数字的融合

我们终于把数字电源的全链路走通了：从模型的建立，到 z 域的设计，再到代码结构的实现，最后直面量化噪声的挑战。

回头看这一章，我们其实是在解决一个核心矛盾：如何用离散的、有限精度的 0 和 1，去模拟连续的、无限精度的物理世界？

• 我们用 Z 变换 架起了模拟域和数字域的桥梁。
• 我们用 抗饱和限幅器 弥补了数字积分器的脆弱。
• 我们用 高分辨率 DPWM 和 ΔΣ 调制 对抗了量化误差的幽灵。

在下一章，我们将把目光从单一变换器的控制移开，看向更广阔的领域。你会发现，今天建立的这些数字控制思维——采样、延迟、离散传递函数——将在那里以一种完全不同的尺度再次出现。

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练习题

练习 1：understanding

题目：在一个 Buck 变换器数字控制系统中，输入电压 $V_g=5V$，期望的输出电压调节精度为 1%。若系统采用了 10 位的 DPWM（数字脉冲宽度调制器），请计算该 DPWM 量化步长 $q_{DPWM}$ 引起的输出电压最小变化量 $\mathrm{\Delta }V$，并判断其是否满足调节精度的要求。

答案与解析

答案：计算得出 $\mathrm{\Delta }V=4.88mV$。在 5V 输入下，若期望输出电压为 2.5V（D=0.5），1% 的精度要求为 25mV。由于 $4.88mV<25mV$，因此满足要求。

解析：1. 首先计算 DPWM 的量化步长 $q_{DPWM}$。根据定义，$n_{DPWM}=10$，则 $q_{DPWM}=1/2^{10}=1/1024\approx 0.000977$。 2. 根据电压定位分辨率公式 $\mathrm{\Delta }V=q_{DPWM}{V}_g$，代入数值：$\mathrm{\Delta }V=(1/1024)\times 5V\approx 4.88mV$。 3. 比较 $\mathrm{\Delta }V$ 与期望精度。$\mathrm{\Delta }V$ 代表了占空比改变 1 LSB 时输出电压的变化。只要这个变化量小于系统允许的电压波动范围，就能保证稳压精度。

练习 2：application

题目：某数字控制电源的开关频率 $f_s=200kHz$，采样频率等于开关频率。数字补偿器的计算时间 $t_{ctrl}=1.2\mu s$，采用后沿调制的 DPWM，占空比 $D=0.4$。请计算该控制环路的总延迟 $t_d$，并估算该延迟在穿越频率 $f_c=20kHz$ 处引入的相位滞后。

答案与解析

答案：总延迟 $t_d=3.2\mu s$；引入的相位滞后约为 ${23}^{\circ }$。

解析：1. 计算调制器延迟 $t_{mod}$。对于后沿调制，$t_{mod}=D{T}_s$。已知 $f_s=200kHz$，则 $T_s=5\mu s$。所以 $t_{mod}=0.4\times 5\mu s=2\mu s$。 2. 计算总延迟 $t_d=t_{ctrl}+t_{mod}=1.2\mu s+2\mu s=3.2\mu s$。 3. 计算相位滞后。延迟环节 $e^{-s{t}_d}$ 在频率 $\omega$ 处的相位为 $-\omega t_d=-2\pi f{t}_d$。代入 $f_c=20kHz$，相位滞后 $=-2\pi \times 20000\times 3.2\times {10}^{-6}\approx -0.402extrad\approx -{23}^{\circ }$。

练习 3：application

题目：使用双线性映射将一个连续时间的 PI 补偿器 $G_c(s)=K_p+\frac{K_i}{s}$ 转换为离散时间补偿器 $G_{cd}(z)$。请写出映射公式，并推导得出的离散域传递函数表达式。

答案与解析

答案：$G_{cd}(z)=K_p+K_i\frac{T_s}{2}\frac{z+1}{z-1}$。

解析：双线性映射（Tustin 方法）的核心公式是将 $s$ 替换为 $\frac{2}{T_s}\frac{z-1}{z+1}$。 将 PI 补偿器分解处理：比例项 $K_p$ 保持不变。 积分项 $\frac{K_i}{s}$ 变换为：

$$\frac{K_i}{s}\to \frac{K_i}{\frac{2}{T_s}\frac{z-1}{z+1}}=K_i\frac{T_s}{2}\frac{z+1}{z-1}$$

因此，总的离散传递函数为两项之和。

练习 4：thinking

题目：在设计高频数字控制电源时，我们经常面临 DPWM 分辨率与计算时钟频率的矛盾。假设开关频率为 1 MHz，为了达到等效 12 位的电压调节精度，使用标准计数器方法实现 DPWM 需要极高的系统时钟频率。请问：

1. 需要多高的系统时钟频率？
2. 为了解决这一难题，请结合本章知识点，列举两种可以在不提高系统时钟频率的前提下提高 DPWM 分辨率的技术，并简述其原理。

答案与解析

答案：1. 所需时钟频率 $f_{clk}=4096MHz$ (即 4.096 GHz)。 2. 两种技术：

• 抽头延迟线：利用逻辑门之间的传输延迟来产生远小于系统时钟周期的时间步长。
• ΔΣ 调制器：利用噪声整形技术将量化噪声推至高频，再利用功率级的低通滤波特性滤除噪声，从而在平均值上获得更高的等效分辨率。

解析：1. 标准计数器 DPWM 的时钟频率公式为 $f_{clk}=2^{n_{DPWM}}{f}_s$。若 $n=12$，$f_s=1MHz$，则 $f_{clk}=4096MHz$。这在硬件实现上非常困难且功耗巨大。 2. 针对这一矛盾，可以采用混合信号或先进的数字调制技术：

• Tapped Delay Line：不依赖于快速计数，而是利用信号通过逻辑门（如缓冲器）的固有传播延迟。通过组合多个门延迟，可以构建出极高分辨率的时间步长，而主控逻辑仍运行在较低的时钟频率。
• Delta-Sigma Modulator：这是一种过采样技术。它在补偿器和 DPWM 之间插入一个调制器，故意将量化误差（噪声）整形到高频段（> $f_s/2$）。由于功率级本身具有低通特性，这些高频噪声会被滤除，而输出的平均占空比却具有非常高的精细度。

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要点提炼

数字控制通过离散化带来了灵活性，但也引入了模拟世界不存在的“台阶”与“延迟”挑战。A/D 转换器和 DPWM（数字脉宽调制）的分辨率有限，直接决定了系统的稳压精度。若 A/D 的最小量化台阶（LSB）过大，微小的电压误差将被系统“视而不见”；而 DPWM 的位数若不足，会导致占空比调节过于粗糙，在高压差应用中这一问题尤为严峻，往往迫使工程师采用延迟线或 $\mathrm{\Delta }\mathrm{\Sigma }$ 调制等“黑科技”来在不提高时钟频率的前提下伪造高分辨率。

除了幅度上的量化，时间上的离散化引入了潜伏的相位杀手——环路延迟。在数字环路中，从 A/D 采样、计算到 PWM 更新，整个过程并非瞬间完成，而是存在计算延迟和调制延迟。这种延迟在频域表现为纯滞后环节 $e^{-s{t}_d}$，它会随着频率升高带来巨大的相位滞后，直接吞噬相位裕度。这也是为什么高频数字电源设计必须极度严苛地控制代码运行时间，或者在模拟设计阶段就预留出额外的相位冗余来补偿这一损失。

为了在数字域复现模拟控制器的性能，工程师需要利用 Z 变换搭建桥梁。通过双线性映射（Tustin 变换）及其预畸变技术，可以将熟悉的模拟补偿器（如 PID）“翻译”成离散形式的传递函数 $G_{cd}(z)$。特别是在关键的穿越频率处使用预畸变，可以保证数字控制器的频率响应与模拟设计高度一致。而在代码实现时，Z 域中的 $z^{-1}$ 算子对应于代码中的一个简单的存储单元（延迟），微积分运算最终转化为了加减乘除的循环迭代。

数字 PID 的实现结构直接影响了系统的可调试性与稳定性。相比于参数耦合严重的级联形式，并联实现结构将比例（P）、积分（I）和微分（D）通道分开，允许像调节调音台一样独立整定参数。此外，数字积分器格外脆弱，极易在误差过大时发生“饱和”（Wind-up），导致恢复缓慢甚至失控，因此必须引入抗饱和限幅逻辑，在积分值溢出时强行将其拉回安全范围，这通常是代码中最关键的“安全带”。

当系统看似稳定时，仍可能受困于一种特殊的非线性震荡——极限环振荡。这是由于量化误差引起的：如果 DPWM 调节一步造成的电压跳变超过了 A/D 的分辨率（$G_{d0}{H}_0{q}_{DPWM}<q_{A/D}$），或者积分器的增益过大，系统就会找不到平衡点，在两个量化台阶间反复横跳。消除这种“数字心跳”必须同时满足硬件分辨率和积分增益的双重约束，这是高精度数字电源设计中不可忽视的最后一道防线。

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参考说明：参考自 geqianQWQ 同学阅读《Fundamentals of Power Electronics》的笔记，仅作理解线索；本文为结合自己理解重新整理的学习笔记，不涉及对原书的复制或翻译。